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图书信息
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ASIC设计与合成:使用Verilog进行RTL设计
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| ISBN： | 9787030788283 |
定价： | ￥78.00 |
| 作者： | (印)瓦伊巴夫·塔拉特著 |
出版社： | 科学出版社 |
| 出版时间： | 2024年06月 |
开本： | 26cm |
| 页数： | 11,270页 |
装祯： | 平装 |
中图法： | TN402 |
相关供货商
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供货商名称
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库存量
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库区
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更新日期
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北京人天书店有限公司
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87
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库区13/库区4/样本13/样本4
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2026-06-11
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其它供货商库存合计
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202
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2026-06-10
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图书简介 | | 本书全面介绍使用Verilog进行RTL设计的ASIC设计流程和综合方法。本书共20章，内容包括ASIC设计流程、时序设计、多时钟域设计、低功耗的设计考虑因素、架构和微架构设计、设计约束和SDC命令、综合和优化技巧、可测试性设计、时序分析、物理设计、典型案例等。本书提供了大量的练习题和案例分析，可以帮助读者更好地理解和掌握所学的知识。 |
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