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图书信息
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FPGA时序分析和约束
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| ISBN： | 9787302699828 |
定价： | ￥69.00 |
| 作者： | 常建芳, 编著 |
出版社： | 清华大学出版社 |
| 出版时间： | 2025年08月 |
版次： | 1版 |
| 开本： | 26 |
页数： | -1 |
| 装祯： | 平装 |
中图法： | TP332.1 |
相关供货商
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供货商名称
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更新日期
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其它供货商库存合计
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500
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2025-08-18
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图书简介 | | 本书共8章，第1章以生活场景时序例子开篇，介绍FPGA及Vivado编译工具，阐述时序分析和约束意义，描述FPGA时序约束整体框架。第2章从建立/保持时间、启动沿/锁存沿等概念切入，分析io2reg、reg2reg、reg2io和io2io四种基本路径时序。第3章聚焦时钟分析与约束，涵盖主时钟、抖动、不确定性、延时、虚拟时钟和衍生时钟约束。第4章讲述输入/输出延时约束，依次分析输入延时约束和输出延时约束。第5章开篇阐述时序例外约束意义，分析伪路径、时钟组、最大/最小延时、多周期路径约束，说明其优先级和逻辑设计方法。第6章汇总其他时序约束，如CaseAnalysis、DisableTiming等。第7章设计简单时序工程，覆盖前几章各种时序路径并进行约束。第8章总结时序约束技巧，分享作者学习历程并引用前辈经验资料。 |
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