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图书信息
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基于Quartus Prime的数字系统Verilog HDL设计实例详解
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| ISBN： | 9787121348983 |
定价： | ￥99.00 |
| 作者： | 周润景，李志，张玉光编著 |
出版社： | 电子工业出版社 |
| 出版时间： | 2018年09月 |
版次： | 3版 |
| 开本： | 26cm |
页数： | 460页 |
中图法： | TP312VH |
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2026-04-02
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图书简介 | | 本书以语法与实例结合的方式来讲解可编程逻辑器件的设计方法，软件开发平台为Altera公司的Quartus Prime 16.1 FPGA/CPLD设计软件。本书由浅入深地介绍了利用Quartus Prime进行数字系统开发的设计流程、设计思想和设计技巧。书中的例子非常丰富，既有简单的数字逻辑电路实例，也有复杂的数字系统设计实例。 |
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